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CPU設(shè)計(jì)實(shí)驗(yàn)報(bào)告,源代碼
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資料類別
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計(jì)算機(jī)教案 |
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課程(專業(yè))
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CPU設(shè)計(jì) |
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關(guān)鍵詞
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CPU設(shè)計(jì)|寄存器 |
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適用年級(jí)
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高職 |
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身份要求
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游客 |
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金 幣
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0 �。�金幣如何獲得？） |
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文件格式
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Word |
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文件大小
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2175K |
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發(fā)布時(shí)間
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2010-04-22 21:00:00 |
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無(wú) |
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139 |
| 發(fā)布人 |
lj |
內(nèi)容簡(jiǎn)介：
CPU設(shè)計(jì)實(shí)驗(yàn)報(bào)告,源代碼
一、實(shí)驗(yàn)?zāi)康模?br>
1、掌握硬件描述語(yǔ)言VHDL和EDA工具Quartus II；利用VHDL設(shè)計(jì)16位串行CPU，實(shí)現(xiàn)算術(shù)和邏輯運(yùn)算指令、轉(zhuǎn)移指令、訪存指令、堆棧指令和控制指令；
2、掌握CPU的調(diào)試和測(cè)試方法。
二、實(shí)驗(yàn)內(nèi)容：
1、運(yùn)用硬件描述語(yǔ)言VHDL實(shí)現(xiàn)寄存器堆和算數(shù)邏輯單元設(shè)計(jì)、指令集和指令格式、時(shí)序設(shè)計(jì)和整體結(jié)構(gòu)設(shè)計(jì)、指令譯碼器的設(shè)計(jì)、訪存單元的設(shè)計(jì)、調(diào)試單元的設(shè)計(jì)；
2、上機(jī)調(diào)試。
三、實(shí)驗(yàn)步驟：
1、寄存器堆的設(shè)計(jì)
寄存器堆由16個(gè)16位寄存器組成 。其中reset是異步清0端，reset=0時(shí)將所有寄存器清0。dr_sel和sr_sel是目標(biāo)寄存器和源寄存器編號(hào)，dr_out和sr_out輸出目標(biāo)寄存器和源寄存器的內(nèi)容。reg_sel指定一個(gè)寄存器編號(hào)，將該寄存器內(nèi)容送給reg_out，這兩個(gè)端口用于調(diào)試時(shí)觀察每個(gè)寄存器的值。reg_en是寫(xiě)允許端。reg_en=“01”時(shí)，在clk的上升沿將from_alu寫(xiě)入dr_sel指定的寄存器；reg_en=“10”時(shí)，在clk的上升沿將from_mem寫(xiě)入dr_sel指定的寄存器。reg_en取其他值時(shí)不改變寄存器堆的值。
......
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