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    自動售飲料機系統(tǒng)設(shè)計
    資料類別
       電子電工畢業(yè)論文(設(shè)計)
    課程(專業(yè))
      應(yīng)用電子
    關(guān)鍵詞
      EDA|自動售飲料機
    適用年級
      高職
    身份要求
      普通會員
    金 幣
      48  (金幣如何獲得?

    文件格式

      word
    文件大小
      229K
    發(fā)布時間
      2009-06-04 18:34:00
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    下載次數(shù)
      3
    發(fā)布人   fengchan
     內(nèi)容簡介:     課程設(shè)計 自動售飲料機系統(tǒng)設(shè)計,共12頁,3063字。
       目錄
       一、自動售飲料機系統(tǒng)設(shè)計任務(wù)書
       二、自動售飲料機方案
       三、自動售飲料機控制系統(tǒng)設(shè)計詳細說明
       1.系統(tǒng)完整程序代碼及系統(tǒng)測試程序代碼
       2.系統(tǒng)的頂層原理圖、RLT級原理圖、technology級原理圖
       3.前仿真波形及分析
       4.綜合后仿真波形及分析
       5.EDA試驗箱的實驗下載及調(diào)試
       6.系統(tǒng)原理圖
       四、系統(tǒng)設(shè)計工作進程
       1.小組成員分工及安排
       2.工作日程表
       3.本人承擔的任務(wù)和執(zhí)行的情況
       五 、收獲和體會
       六、參考文獻
      
       前言
       隨著電子技術(shù)和計算機技術(shù)的飛速發(fā)展,電子線路的設(shè)計工作也日益顯得重要。經(jīng)過人工設(shè)計、制作實驗板、調(diào)試再修改的多次循環(huán)才定型的傳統(tǒng)產(chǎn)品設(shè)計方法必然被計算機輔助設(shè)計所取代,因為這種費時費力又費資源的設(shè)計調(diào)試方法既增加了產(chǎn)品開發(fā)的成本,又受到實驗工作場地及儀器設(shè)備的限制。為了克服上述困難,加拿大Interactive Image Technologies公司推出的基于Windows 95/98/NT操作系統(tǒng)的EDA軟件。他可以將不同類型的電路組合成混合電路進行仿真。此外,從另一角度來看,隨著計算機技術(shù)和集成電路技術(shù)的發(fā)展,現(xiàn)代電子與電工設(shè)計,已經(jīng)步入了電子設(shè)計自動化(EDA)的時代,采用虛擬仿真的手段對電子產(chǎn)品進行前期工作的調(diào)試,已成為一種發(fā)展的必然趨勢。通過對實際電子線路的仿真分析,從而提高對電路的分析、設(shè)計和創(chuàng)新能力。
       數(shù)字集成電路本身在不斷地進行更新?lián)Q代。它由早期的電子管、晶體管、小中規(guī)模集成電路、發(fā)展到超大規(guī)模集成電路(VLSIC,幾萬門以上)以及許多具有特定功能的專用集成電路。但是,隨著微電子技術(shù)的發(fā)展,設(shè)計與制造集成電路的任務(wù)已不完全由半導體廠商來獨立承擔。系統(tǒng)設(shè)計師們更愿意自己設(shè)計專用集成電路(ASIC)芯片,而且希望ASIC的設(shè)計周期盡可能短,最好是在實驗室里就能設(shè)計出合適的ASIC芯片,并且立即投入實際應(yīng)用之中,因而出現(xiàn)了現(xiàn)場可編程邏輯器件(FPLD),其中應(yīng)用最廣泛的當屬現(xiàn)場可編程門陣列(FPGA)和復(fù)雜可編程邏輯器件(CPLD)。
       FPGA(現(xiàn)場可編程門陣列)與 CPLD(復(fù)雜可編程邏輯器件)都是可編程邏輯器件,它們是在PAL,GAL等邏輯器件的基礎(chǔ)之上發(fā)展起來的。同以往的PAL,GAL等相比較,F(xiàn)PGA/CPLD的規(guī)模比較大,它可以替代幾十甚至幾千塊通用IC芯片。這樣的FPGA/CPLD實際上就是一個子系統(tǒng)部件。
       本次EDA課程設(shè)計就是利用VerilogHDL來設(shè)計基于ACEX1K30TC144-3型號的FPGA來設(shè)計一個自動售貨機,機器設(shè)有2個投幣孔,可以接受一元和五角的硬幣,每瓶飲料2.5元,可用2個按鍵來代替。還設(shè)有2個輸出,要求有找零和提示信號,分別輸出飲料和找零,設(shè)計按照EDA課程設(shè)計的流程,源代碼的編寫,前仿真,綜合,然后布局布線,后仿真,前、后仿真驗證成功后,下載到FPGA實驗箱上進行驗證。本此設(shè)計綜合利用ModelSim SE 6.0、leonardospectrum、MAX+PLUS2 10.0等設(shè)計軟件進行課程設(shè)計。

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