南昌航空大學(xué)科技學(xué)院畢業(yè)設(shè)計 基于FPGA的通用異步收發(fā)器的設(shè)計
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資料類別
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電子電工畢業(yè)論文(設(shè)計) |
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課程(專業(yè))
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應(yīng)用電子技術(shù) |
關(guān)鍵詞
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FPGA|仿真 |
適用年級
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大學(xué) |
身份要求
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普通會員 |
金 幣
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60 (金幣如何獲得?) |
文件格式
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word |
文件大小
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178K |
發(fā)布時間
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2009-11-05 12:49:00 |
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無 |
下載次數(shù)
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1 |
發(fā)布人 |
fengchan |
內(nèi)容簡介:
南昌航空大學(xué)科技學(xué)院畢業(yè)設(shè)計 基于FPGA的通用異步收發(fā)器的設(shè)計,共38頁,18251字。
摘要:EDA 技術(shù)作為現(xiàn)代電子設(shè)計技術(shù)的核心,它依賴強大的計算機,在EDA工具軟件平臺上,對以硬件描述語言VHDL為邏輯描述手段完成的設(shè)計文件,自動地完成邏輯編譯、邏輯簡化、邏輯分割、邏輯綜合、結(jié)構(gòu)綜合,以及邏輯優(yōu)化和仿真測試,直到實現(xiàn)既定的電子線路系統(tǒng)功能。EDA技術(shù)使得設(shè)計者的工作僅限于利用軟件的方式,即利用硬件描述語言和EDA軟件來完成對系統(tǒng)硬件功能的。本文采用EDA技術(shù)對通用異步收發(fā)器的設(shè)計。
本設(shè)計采用的是可編程邏輯器件FPGA實現(xiàn)UART的功能,將FPGA的核心功能集成到FPGA上。FPGA由可編程邏輯單元陣列、布線資源和可編程的I/O單元陣列構(gòu)成,一個FPGA包含豐富的邏輯門、寄存器和I/O資源[7]。一片F(xiàn)PGA芯片就可以實現(xiàn)數(shù)百片甚至更多個標(biāo)準(zhǔn)數(shù)字集成電路所實現(xiàn)的系統(tǒng)。
UART(通用異步接收發(fā)送設(shè)備) 是一種短距離串行傳輸接口。在數(shù)字通信和控制系統(tǒng)中得到廣泛應(yīng)用。FPGA和CPLD 是大規(guī)模集成電路技術(shù)發(fā)展的產(chǎn)物,是一種半定制的集成電路。結(jié)合計算機開發(fā)平臺技術(shù)( EDA技術(shù)) 可以快速、方便地構(gòu)建數(shù)字系統(tǒng)。本課題采用可編程邏輯器件FPGA 實現(xiàn)UART的功能,將UART的核心功能集成到FPGA 上,硬件采用Altera公司的FPGA芯片,本設(shè)計包含UART 的發(fā)送模塊、接收模塊和波特率發(fā)生器模塊,所有功能的實現(xiàn)全部采用VHDL 硬件描述語言來進(jìn)行描述。設(shè)計、綜合、仿真在QUARTUSII 軟件開發(fā)環(huán)境下實現(xiàn)。
關(guān)鍵詞 :UART VHDL FPGA 仿真
目錄
1 緒論 1
1.1 引言 1
1.2 選題的依據(jù)及意義 1
1.3 國內(nèi)外研究概況及發(fā)展趨勢 2
1.4 課題主要研究內(nèi)容 3
2 相關(guān)知識的介紹 5
2.1 FPGA(現(xiàn)場可編程門陣列)芯片 5
2.2 硬件描述語言(VHDL) 10
2.3 EDA技術(shù) 12
3 UART總體設(shè)計 15
3.1 UART簡介 15
3.2 UART的基本特點 15
3.3 基于FPGA的UART原理框圖 16
4 系統(tǒng)具體設(shè)計 17
4.1 Quartus II開發(fā)平臺的簡介 17
4.2 系統(tǒng)頂層設(shè)計 18
4.3 系統(tǒng)底層設(shè)計 20
4.3.1 波特率發(fā)生器模塊 20
4.3.2 UART接收器模塊 21
4.3.3 UART發(fā)送器模塊 25
5 系統(tǒng)仿真及結(jié)果 29
5.1 VHDL源程序仿真 29
5.2 波特率發(fā)生器的仿真結(jié)果 30
5.3 UART接收器的仿真波形結(jié)果 31
5.4 UART發(fā)送器的仿真波形結(jié)果 31
6 本文總結(jié) 32
6.1 研究總結(jié) 32
6.2 進(jìn)一步工作展望 33
參考文獻(xiàn) 33
致謝 35
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