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數(shù)據(jù)采集器設(shè)計(jì)
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資料類別
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電子電工畢業(yè)論文（設(shè)計(jì)） |
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課程(專業(yè))
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數(shù)字電子技術(shù) |
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關(guān)鍵詞
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FPGA|DSP |
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適用年級(jí)
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大學(xué) |
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身份要求
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普通會(huì)員 |
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金 幣
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60 �。�金幣如何獲得？） |
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文件格式
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Word |
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文件大小
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282K |
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發(fā)布時(shí)間
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2010-06-16 18:31:00 |
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內(nèi)容簡(jiǎn)介：
課程設(shè)計(jì) 數(shù)據(jù)采集器設(shè)計(jì)，共25頁(yè)，5037字
第一章 緒論
隨著科學(xué)技術(shù)和國(guó)民經(jīng)濟(jì)的發(fā)展，電能需求量日益增加，對(duì)電能質(zhì)量的要求也越來(lái)越高。這對(duì)電能質(zhì)量的監(jiān)測(cè)提出了挑戰(zhàn)。電能質(zhì)量的監(jiān)測(cè)往往需要多通道數(shù)據(jù)采集，但因其覆蓋面積大，周期性強(qiáng)，采集數(shù)據(jù)量大，因此對(duì)數(shù)據(jù)采集系統(tǒng)的采集、傳輸速度和精度提出了較高的要求。常用的數(shù)據(jù)采集方案往往采用單片機(jī)或數(shù)字信號(hào)處理器(DSP)作為控制器。以控制模數(shù)轉(zhuǎn)換器(ADC)、存儲(chǔ)器和其他外圍電路的工作。但因單片機(jī)自身指令周期及處理速度的影響，很難達(dá)到多通道高速數(shù)據(jù)采集系統(tǒng)的要求，雖然DSP可以實(shí)現(xiàn)較高速的數(shù)據(jù)采集，但在提高其速度的同時(shí)，也增加了系統(tǒng)成本�，F(xiàn)場(chǎng)可編程門陣列(FPGA)以其時(shí)鐘頻率高，內(nèi)部延時(shí)小，速度快，效率高，組成形式靈活等特點(diǎn)在高速數(shù)據(jù)采集方面有著單片機(jī)和DSP無(wú)法比擬的優(yōu)勢(shì)。
數(shù)據(jù)采集和控制系統(tǒng)是對(duì)生產(chǎn)過(guò)程或科學(xué)實(shí)驗(yàn)中各種物理量進(jìn)行實(shí)時(shí)采集、測(cè)試和反饋控制的閉環(huán)控制，它在工業(yè)控制、軍事電子設(shè)備、醫(yī)學(xué)監(jiān)護(hù)等許多領(lǐng)域發(fā)揮著重要作用。其中，數(shù)據(jù)采集部分尤為重要，而傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)，通常采用單片機(jī)或DSP作為控制器，用以控制ADC、存儲(chǔ)器和其他外圍電路的工作，使得采集速度和效率降低。近年來(lái)，微電子技術(shù)，如：大規(guī)模集成電路和超大規(guī)模集成電路技術(shù)的發(fā)展，為數(shù)據(jù)采集系統(tǒng)的發(fā)展提供了良好的物質(zhì)基礎(chǔ)。從而使器件向模塊化和單片化發(fā)展，使所用軟件均向?qū)崟r(shí)高級(jí)語(yǔ)言和軟件模塊化發(fā)展，接口向標(biāo)準(zhǔn)化發(fā)展。由于FPGA時(shí)鐘頻率高，內(nèi)部延時(shí)小，全部控制邏輯均由硬件完成，速度快，效率高，同時(shí)它有非常強(qiáng)大的硬件描述語(yǔ)言和仿真工具，方便檢驗(yàn)結(jié)果的正確性�；谝陨峡紤]，在設(shè)計(jì)中采用FPGA作為控制處理器。而VGA接口的設(shè)計(jì)，更突出了該模塊的兼容性，更易于采集數(shù)據(jù)的直觀表現(xiàn)。
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