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EDA技術(shù)課程大作業(yè) 智力競(jìng)賽搶答計(jì)時(shí)器的設(shè)計(jì)
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資料類別
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電子電工畢業(yè)論文（設(shè)計(jì)） |
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課程(專業(yè))
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EDA技術(shù) |
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關(guān)鍵詞
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EDA技術(shù)|搶答計(jì)時(shí)器 |
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適用年級(jí)
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大學(xué) |
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身份要求
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普通會(huì)員 |
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金 幣
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20 �。�金幣如何獲得？） |
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文件格式
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word |
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文件大小
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1347K |
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發(fā)布時(shí)間
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2011-04-24 19:36:00 |
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無(wú) |
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2 |
| 發(fā)布人 |
kj008 |
內(nèi)容簡(jiǎn)介：
EDA技術(shù)課程大作業(yè) 智力競(jìng)賽搶答計(jì)時(shí)器的設(shè)計(jì)，正文共11頁(yè)，1995字。
1設(shè)計(jì)背景和設(shè)計(jì)方案
1.1摘要
現(xiàn)代生活中，數(shù)字電路產(chǎn)品與我們接觸的是越來(lái)越平凡了，包括計(jì)算機(jī)、電子表、智能儀器表及其它很多領(lǐng)域中，它給我們帶來(lái)的不僅是工作上的方便，而且也給我們的生活?yuàn)蕵?lè)添滋加彩。這次EDA課程設(shè)計(jì)中，我做的是四人搶答器，基于設(shè)計(jì)要求，本文主要是從鎖存器及計(jì)數(shù)器功能和VHDL語(yǔ)言著手，但側(cè)重點(diǎn)在用VHDL語(yǔ)言上。
1.2設(shè)計(jì)背景
數(shù)字電路主要是基于兩個(gè)信號(hào)（我們可以簡(jiǎn)單的說(shuō)是有電壓和無(wú)電壓），用數(shù)字信號(hào)完成對(duì)數(shù)字量進(jìn)行算術(shù)運(yùn)算和邏輯運(yùn)算的電路我們稱之為數(shù)字電路，它具有邏輯運(yùn)算和邏輯處理等功能，數(shù)字電路可分為組合邏輯電路和時(shí)序邏輯電路。
EDA技術(shù)又稱電子設(shè)計(jì)自動(dòng)化，它是為解決自動(dòng)控制系統(tǒng)設(shè)計(jì)而提出的，從70年代經(jīng)歷了計(jì)算機(jī)輔助設(shè)計(jì)（CAD），計(jì)算機(jī)輔助工程（CAE），電子系統(tǒng)設(shè)計(jì)自動(dòng)化（ESDA）3個(gè)階段。前兩個(gè)階段的EDA產(chǎn)品都只是個(gè)別或部分的解決了電子產(chǎn)品設(shè)計(jì)中的工程問(wèn)題；第三代EDA工具根據(jù)工程設(shè)計(jì)中的瓶頸和矛盾對(duì)設(shè)計(jì)數(shù)據(jù)庫(kù)實(shí)現(xiàn)了統(tǒng)一管理，并提出了并行設(shè)計(jì)環(huán)境概念，提供了獨(dú)立于工藝和廠家的系統(tǒng)級(jí)的設(shè)計(jì)工具。
VHDL（VERY HIGH SPEED INTEGRATED CIRCUIT HARDWARE DESCRIPTION LANGUAGE）語(yǔ)言最早是有美國(guó)國(guó)防部提出的，它支持行為領(lǐng)域和結(jié)構(gòu)領(lǐng)域的硬件描述，并且可以從最抽象的系統(tǒng)級(jí)一直到最精確的邏輯級(jí)，在描述數(shù)字系統(tǒng)時(shí)，可以使用前后一致的語(yǔ)義和語(yǔ)法跨越多個(gè)層次，并且使用跨越多個(gè)級(jí)別的混合描述模擬該系統(tǒng)。因此，它可以由高層次行為描述子系統(tǒng)及低層次詳細(xì)實(shí)現(xiàn)子系統(tǒng)所組成的系統(tǒng)模擬。它有兩個(gè)版本IEEEStd1076-1987[LRM87]和IEEEStd1076-1993[LRM93]，他們并不完全兼容，但做一些修改就可以兼容了。
......
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