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    基于verilog語言的音樂播放器的設(shè)計
    資料類別
       電子電工畢業(yè)論文(設(shè)計)
    課程(專業(yè))
      電子通信
    關(guān)鍵詞
      EDA|Quartus II|Verilog HDL|樂曲演奏電路|畢業(yè)設(shè)計
    適用年級
      本科
    身份要求
      普通會員
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    文件格式

      word+PPT
    文件大小
      554K
    發(fā)布時間
      2012-06-12 08:48:00
    預(yù)覽文件
      0933080.jpg(只能預(yù)覽部分內(nèi)容)
    下載次數(shù)
      4
    發(fā)布人   lpf2176
     內(nèi)容簡介:     本科畢業(yè)設(shè)計 基于verilog語言的音樂播放器的設(shè)計
       EDA|Quartus II|Verilog HDL|樂曲演奏電路|畢業(yè)設(shè)計
       文件格式:word+PPT
      
       一套完整的畢業(yè)設(shè)計,包括開題報告、任務(wù)書、論文正文、答辯PPT、中英文翻譯。
       有預(yù)覽文件請查看。
       論文正文共24頁。共15675字符數(shù)(不計空格)。整套壓縮包大。556KB。
       中英文翻譯 Electronic Design Automation(電子設(shè)計自動化)
      
       摘要
       利用EDA開發(fā)工具Quartus II 7.2,系統(tǒng)實現(xiàn)是用硬件描述語言Verilog HDL按分頻控制的方式進行設(shè)計,然后進行編程、時序仿真、電路功能驗證,奏出美妙的樂曲。在EDA技術(shù)領(lǐng)域中把用HDL語言建立的數(shù)字模型稱為軟核(soft core),把用HDL語言建模和綜合后生成的網(wǎng)表稱為固核(hard core),對這些模塊的重復(fù)利用縮短了開發(fā)時間,提高了產(chǎn)品開發(fā)率,提高了設(shè)計效率。
       關(guān)鍵詞:EDA,Quartus II,Verilog HDL,樂曲演奏電路
      
       Verilog language-based music player design
       Major:Electronic Engineering No:7020908088
       Name of student:Xie Jing Ming Instructor:Tao Ling
       ABSTRACT:Use of EDA tools Quartus II 7.2, System using a hardware description language Verilog HDL design in the frequency control and programming, timing simulation, circuit functional verification, to play the wonderful music. HDL language to establish numerical models in the field of EDA technology, known as soft-core (soft core), netlist generated HDL language modeling and as a solid nucleus (hard core), on the repeated use of these modules shorten the development time and increase the rate of product development, improve design efficiency.
       Keywords: EDA, Quartus II, Verilog HDL, music playing circuit
      
       目錄
       摘要: I
       ABSTRACT: II
       第一章 緒論 1
       1.1 EDA電子技術(shù)的背景 1
       1.2 EDA技術(shù)發(fā)展史 1
       1.3 EDA技術(shù)發(fā)展動態(tài) 2
       1.4 主要研究思路 2
       第二章 EDA技術(shù)簡介 3
       2.1 可編程邏輯器件 3
       2.2 Verilog HDL語言 3
       2.3 QUARTUS Ⅱ 7.2簡介 3
       第三章 基于Verilog 音樂播放器的設(shè)計 6
       3.1 設(shè)計原理 6
       3.1.1 音調(diào)的控制 6
       3.1.2音長的控制 7
       3.2 音樂播放器結(jié)構(gòu) 8
       第四章 程序設(shè)計與仿真 9
       4.1 系統(tǒng)分析 9
       4.2 程序設(shè)計 9
       4.3 系統(tǒng)仿真 11
       4.4 結(jié)果分析 12
       結(jié)論 13
       參考文獻(References) 14
       致謝 15

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