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利用VHDL語言在FPGA上實現(xiàn)I2C總線控制器的功能
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資料類別
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電子電工畢業(yè)論文（設(shè)計） |
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課程(專業(yè))
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通信工程 |
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關(guān)鍵詞
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總線控制器|現(xiàn)場可編程邏輯門陣列 |
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適用年級
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大學(xué) |
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身份要求
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普通會員 |
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金 幣
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40 �。�金幣如何獲得？） |
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文件格式
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pdf |
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文件大小
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6033K |
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發(fā)布時間
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2018-02-01 09:17:00 |
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預(yù)覽文件
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無 |
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下載次數(shù)
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1 |
| 發(fā)布人 |
kj008 |
內(nèi)容簡介：
利用VHDL語言在FPGA上實現(xiàn)I2C總線控制器的功能，畢業(yè)論文，說明書共34頁。
摘要
隨著微電子技術(shù)的發(fā)展， 現(xiàn)場可編程邏輯門陣列 FPGA C FieldProgrammable Gate Array ）可以實現(xiàn)數(shù)字電路系統(tǒng)設(shè)計的功能。 尤其現(xiàn)場可編程邏輯門陣列 FPGA 具有集成度高的優(yōu)點， 受到工程界高度的重視。 r2c總線以接口簡單， 成本底， 可擴展性好在數(shù)字系統(tǒng)中得到了廣泛的應(yīng)用。硬件描述語言是數(shù)字系統(tǒng)高層設(shè)計的核心， 是實現(xiàn)數(shù)字系統(tǒng)設(shè)計新方法的關(guān)鍵技術(shù)之一。
本課題正是利用 VHDL 語言在 FPGA 上實現(xiàn) I2c 總線控制器的功能。
首先研究了 I2c 總線的規(guī)范， 又簡要介紹了 Quartus II 設(shè)計環(huán)境以及 FPGA的設(shè)計流程。 在此基礎(chǔ)上， 重點介紹了 I2c 控制器的總體設(shè)計方案， 以及在Quartus II 平臺上的時序仿真。
關(guān)鍵詞 Quartus II; r2c 總線控制器：現(xiàn)場可編程邏輯門陣列：時序仿真
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