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基于EDA技術(shù)設(shè)計(jì)的32路彩燈控制器設(shè)計(jì)
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資料類別
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電子電工畢業(yè)論文（設(shè)計(jì)） |
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課程(專業(yè))
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電子信息工程 |
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關(guān)鍵詞
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彩燈控制器|VHDL |
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適用年級(jí)
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大學(xué) |
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身份要求
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普通會(huì)員 |
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金 幣
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40 �。�金幣如何獲得？） |
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文件格式
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word |
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文件大小
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284K |
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發(fā)布時(shí)間
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2018-08-19 18:07:00 |
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預(yù)覽文件
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無 |
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下載次數(shù)
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1 |
| 發(fā)布人 |
kj008 |
內(nèi)容簡(jiǎn)介：
基于EDA技術(shù)設(shè)計(jì)的32路彩燈控制器設(shè)計(jì)，畢業(yè)論文，共45頁(yè)，13138字。
【摘要】隨著科學(xué)技術(shù)的發(fā)展,在現(xiàn)代生活中,節(jié)日彩燈作為一種景觀裝飾被應(yīng)用的領(lǐng)域越來越廣泛。隨著電子技術(shù)的發(fā)展，應(yīng)用系統(tǒng)向著小型化、快速化、大容量、重量輕的方向發(fā)展，EDA技術(shù)的應(yīng)用引起電子產(chǎn)品及系統(tǒng)開發(fā)的革命性變革。VHDL語(yǔ)言作為可編程邏輯器件的標(biāo)準(zhǔn)語(yǔ)言描述能力強(qiáng)，覆蓋面廣，抽象能力強(qiáng)，在實(shí)際應(yīng)用中越來越廣泛，也使人們可以從繁重的設(shè)計(jì)工作中解脫出來，提高設(shè)計(jì)效率，縮短產(chǎn)品研發(fā)周期。整個(gè)過程通過EDA工具自動(dòng)完成，大大減輕了設(shè)計(jì)人員的工作強(qiáng)度，提高了設(shè)計(jì)質(zhì)量，減少了出錯(cuò)的機(jī)會(huì)。
此次設(shè)計(jì)一個(gè)彩燈控制器，可以實(shí)現(xiàn)十六種不同花型的變化。用分頻器來控制實(shí)現(xiàn)調(diào)速按鈕，高電平變化快，低電平變化慢，還要配備清零按鈕。根據(jù)上述的情況來分配任務(wù)，將本次設(shè)計(jì)的主控電路分為兩個(gè)模塊，分別為時(shí)序控制電路模塊和顯示模塊。時(shí)序控制電路是根據(jù)輸入信號(hào)的設(shè)置得到相應(yīng)的輸出信號(hào)，并且將此信號(hào)作為顯示電路的時(shí)鐘信號(hào)；顯示電路輸入時(shí)鐘信號(hào)的周期有規(guī)律的輸出設(shè)定的十六種不同彩燈變化花型。整個(gè)系統(tǒng)共有三個(gè)輸入信號(hào)：控制彩燈節(jié)奏快慢的基準(zhǔn)時(shí)鐘信號(hào)CLK,系統(tǒng)清零信號(hào)CLR，彩燈頻率輸出選擇控制信號(hào)CHOSE_KEY；共有32個(gè)輸出信號(hào)LED[31..0]，分別用于控制32路彩燈。
本文闡述了基于EDA技術(shù)的多路彩燈控制器的設(shè)計(jì)與分析，并在Quartus II 環(huán)境下采用VHDL語(yǔ)言實(shí)現(xiàn)，也得出了采用CPLD進(jìn)行產(chǎn)品開發(fā)可以靈活地進(jìn)行模塊配置，大大縮短了產(chǎn)品開發(fā)周期，也有利于產(chǎn)品向小型化，集成化的方向發(fā)展。論述了基于VHDL語(yǔ)言和CPLD芯片的數(shù)字系統(tǒng)設(shè)計(jì)思想和實(shí)現(xiàn)過程。
關(guān)鍵詞 ：彩燈控制器；VHDL；EDA
目錄
1緒論 1
1.1課題背景 1
1.2研究目的和意義 2
2設(shè)計(jì)內(nèi)容 3
2.1設(shè)計(jì)要求 3
2.2功能描述 3
2.3設(shè)計(jì)原理 4
3模塊設(shè)計(jì)及其功能 5
3.1模塊功能描述 5
3.2時(shí)序控制電路設(shè)計(jì) 5
3.2.1振蕩器 6
3.2.2頻率發(fā)生器 7
3.2.3地址碼產(chǎn)生器 8
3.3顯示控制電路設(shè)計(jì) 10
3.3.1編碼發(fā)生器 11
3.3.2驅(qū)動(dòng)電路 20
4頂層模塊設(shè)計(jì) 21
5彩燈控制器仿真測(cè)試 22
5.1頻率發(fā)生器模塊仿真波形 22
5.2地址碼產(chǎn)生器模塊仿真波形 23
5.3編碼發(fā)生器模塊仿真波形 24
5.4彩燈控制器頂層文件仿真波形 25
6總結(jié) 26
參考文獻(xiàn) 27
致謝 29
附錄程序清單 30
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