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基于FPGA的數(shù)字頻率計(jì)
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資料類(lèi)別
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電子電工畢業(yè)論文（設(shè)計(jì)） |
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課程(專(zhuān)業(yè))
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電子測(cè)量 |
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關(guān)鍵詞
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等精度|數(shù)字頻率計(jì) |
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適用年級(jí)
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大學(xué) |
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身份要求
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普通會(huì)員 |
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金 幣
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50 �。�金幣如何獲得？） |
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文件格式
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word |
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文件大小
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256K |
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發(fā)布時(shí)間
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2008-05-24 22:38:00 |
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預(yù)覽文件
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無(wú) |
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下載次數(shù)
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10 |
| 發(fā)布人 |
kj008 |
內(nèi)容簡(jiǎn)介：
課程設(shè)計(jì) 基于FPGA的數(shù)字頻率計(jì)，共15頁(yè)，4236字
摘 要
等精度頻率計(jì)在工業(yè)生產(chǎn)中具有很重要的作用，它在儀表測(cè)量領(lǐng)域扮演著重要的角色，它應(yīng)用等精度測(cè)頻原理，其測(cè)量精度優(yōu)于普通頻率計(jì)�；趥鹘y(tǒng)測(cè)頻原理的頻率計(jì)的測(cè)量精度將隨被測(cè)信號(hào)頻率的下降而降低，在實(shí)用中有較大的局限性，而等精度頻率計(jì)不但具有較高的測(cè)量精度，而且在整個(gè)頻率區(qū)域能保持恒定的測(cè)試精度。本次設(shè)計(jì)頻率測(cè)量范圍為2K－999KHZ，作品已經(jīng)與DDS信號(hào)源搭配成功的完成了調(diào)試，其測(cè)量精度高，性能穩(wěn)定。
本次設(shè)計(jì)方案是基于FPGA完成全系統(tǒng)設(shè)計(jì)，應(yīng)用ALTERA公司的CYCLONE II芯片構(gòu)成系統(tǒng)主體。本次設(shè)計(jì)的軟件部分應(yīng)用VHDL語(yǔ)言。應(yīng)用 Quartus II 6.0完成系統(tǒng)的設(shè)計(jì)，具有較高的靈活性與可靠性。
關(guān)鍵詞：等精度；頻率計(jì)；FPGA；VHDL
目 錄
引言 ……………………………………………………………………………………1
1 設(shè)計(jì)功能及要求…………………………………………………………………1
2 等精度測(cè)頻原理…………………………………………………………………1
3 FPGA概述…………………………………………………………………………3
3.1 FPGA概念 …………………………………………………………………………3
3.2 設(shè)計(jì)工具Quartus II 6.0 ………………………………………………………4
4 詳細(xì)設(shè)計(jì)方案……………………………………………………………………5
5 結(jié)論………………………………………………………………………………12
謝 辭 ……………………………………………………………………………13
參考文獻(xiàn) ……………………………………………………………………………14
附 錄 ……………………………………………………………………………15
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