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基于VHDL語言的綜合計時系統(tǒng)
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資料類別
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電子電工畢業(yè)論文（設計） |
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課程(專業(yè))
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應用電子 |
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關(guān)鍵詞
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電力電子技術(shù)|晶閘管 |
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適用年級
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大學 |
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身份要求
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普通會員 |
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金 幣
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40 �。�金幣如何獲得？） |
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文件格式
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word |
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文件大小
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300K |
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發(fā)布時間
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2008-12-20 21:34:00 |
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預覽文件
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無 |
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下載次數(shù)
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12 |
| 發(fā)布人 |
kj008 |
內(nèi)容簡介：
畢業(yè)論文 基于VHDL語言的綜合計時系統(tǒng)，共32頁，8954字
摘要：本文介紹了基于VHDL語言的綜合計時系統(tǒng)。該計時系統(tǒng)實現(xiàn)年、月、日、星期以及時間的計時，并通過調(diào)整鍵實現(xiàn)對時間的調(diào)整。
關(guān)鍵詞：VHDL，計時，F(xiàn)PGA
目 錄
1.系統(tǒng)設計要求 ……………………………………………………………… 4
2.系統(tǒng)設計思路 ……………………………………………………………… 4
2.1.綜合計時電路的設計 …………………………………………………4
2.1.1．CNT60計數(shù)模塊的設計 ………………………………………… 5
2.1.2．CNT30計數(shù)模塊的設計 ………………………………………… 5
2.1.3. CNT24計數(shù)模塊的設計 ………………………………………… 6
2.1.4. CNT12計數(shù)模塊的設計 ………………………………………… 6
2.1.5. CNT7 計數(shù)模塊的設計 ………………………………………… 7
2.1.6. CNT100計數(shù)模塊的設計 ………………………………………… 7
2.2.顯示控制電路的設計 …………………………………………………8
2.3.調(diào)整控制電路TZKZQ的設計 ………………………………………9
3.主要VHDL源程序 ………………………………………………………… 10
3.1.綜合計時電路VHDL源程序 ………………………………………10
3.1.1 .CONT60計時電路的VHDL源程序 …………………………… 10
3.1.2. CONT30計時電路的VHDL源程序 ……………………………… 11
3.1.3. CONT24計時電路的VHDL源程序 ……………………………… 13
3.1.4. CONT12計時電路的VHDL源程序 ……………………………… 13
3.1.5. CONT7 計時電路的VHDL源程序 ……………………………… 14
3.1.6. CONT100 計時電路的VHDL源程序 …………………………… 15
3.2.顯示控制電路XSKZQ的VHDL源程序 ……………………………15
3.3.調(diào)整控制TZKZQ的VHDL源程序 ……………………………………19
4.系統(tǒng)仿真圖/硬件驗證 …………………………………………………21
4.1.系統(tǒng)的有關(guān)仿真 ……………………………………………………21
4.1.1.CNT60.VHDL的仿真 ……………………………………………… 21
4.1.2.CNT30.VHDL的仿真 ……………………………………………… 21
4.1.3.CNT24.VHDL的仿真 ……………………………………………… 21
4.1.4.CNT12.VHDL的仿真 ……………………………………………… 21
4.1.5.CNT7.VHDL的仿真 ……………………………………………… 21
4.1.6.CNT100.VHDL的仿真 ……………………………………………… 21
4.1.7.TZKZQ.VHDL的仿真 ……………………………………………… 22
4.1.8.XSKZQ.VHDL的仿真 ……………………………………………… 23
4.2.系統(tǒng)的硬件驗證 ………………………………………………………23
5.系統(tǒng)總體組裝電路的源程序及組裝圖 ………………………………23
6.設計技巧分析 ………………………………………………………………29
7.系統(tǒng)擴展思路 ………………………………………………………………29
8.設計總結(jié) …………………………………………………………………… 29
參考文獻 ……………………………………………………………………… 30
附 圖 ……………………………………………………………………… 30
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