Verilog HDL 華為入門(mén)教程
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資料類(lèi)別
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計(jì)算機(jī)軟件圖書(shū) |
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課程(專(zhuān)業(yè))
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Verilog HDL |
關(guān)鍵詞
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Verilog HDL|華為 |
適用年級(jí)
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大學(xué) |
身份要求
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游客 |
金 幣
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0 (金幣如何獲得?) |
文件格式
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pdf |
文件大小
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258K |
發(fā)布時(shí)間
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2011-12-20 13:58:00 |
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無(wú) |
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31 |
發(fā)布人 |
lj |
內(nèi)容簡(jiǎn)介:
Verilog HDL 華為入門(mén)教程
目錄
16 3.3.4 混合設(shè)計(jì)描述 ..................................................
15 3.3.3 行為描述方式 ..................................................
14 3.3.2 數(shù)據(jù)流描述方式 ................................................
12 3.3.1 結(jié)構(gòu)化描述方式 ................................................
12 3.3 三種建模方式 ......................................................
11 3.2 時(shí)延 .............................................................
11 3.1.3 模塊語(yǔ)法 ......................................................
10 3.1.2 模塊的結(jié)構(gòu) ....................................................
9 3.1.1 簡(jiǎn)單事例 .......................................................
9 3.1 模塊 ..............................................................
9 3 Verilog HDL 建模概述 .....................................................
7 2.4.2 能力 ..........................................................
7 2.4.1 歷史 ..........................................................
7 2.4 Verilog HDL簡(jiǎn)介 .....................................................
6 2.3 設(shè)計(jì)方法學(xué) .........................................................
6 2.2 硬件描述語(yǔ)言 .......................................................
5 2.1 數(shù)字電路設(shè)計(jì)方法 ....................................................
5 2 HDL設(shè)計(jì)方法學(xué)簡(jiǎn)介 ......................................................
5 1 前言 ...................................................................
......
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